VHDL-Grundlagen - Seminar / Kurs von MicroConsult GmbH

VHDL-Grundlagen

Inhalte

Einführung

  • Warum VHDL? Design Flow, Tools, Entwurfsebenen und Sichtweisen
  • IEEE-Standards

Strukturbeschreibung

  • Entity, Architecture, Configuration, Testbench, reservierte Wörter

Verhaltensbeschreibung

  • Process, Wait-Statement, Multi-Wait, Sequential Signal Assignment
  • If, Case und Loops

Bibliotheken und Standards

  • Design Units, Library Clause, Directory Structure
  • Package IEEE.std_logic_1164

Datentypen, Operatoren und Attribute

  • Objekte, Typendeklarationen, Typenumwandlung
  • Arrays and Records, Aggregate

Synthese

  • Logik-Synthese, Beschreibungsstil, Ziel und Vorgaben, Optimierung

RTL, Kombinatorik und Register

  • Integer, Multiplexer, Gefahr von unbeabsichtigten Registern
  • Benutzung von Don't care, Latch, Flip-Flop
  • Synchrone und asynchrone Reset-Signale

Finite State Machine (FSM)

  • Mealy und Moore Automat, Integration Datenflussbeschreibung in FSM
  • Lokale Variablen innerhalb der FSM, Zustandscodierung, explizite Codierung

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Hinweis: Dieses Seminar findet in der Hochschule München statt.

  • Den genauen Versanstaltungsort teilen wir Ihnen in der Durchführungsbestätigung mit.

Lernziele

Durch den VHDL-Kurs kennen Sie die Sprachkonstrukte und Anwendungsmöglichkeiten der Hardwarebeschreibungssprache, können VHDL-Modelle selbständig formulieren, simulieren und synthetisieren und besitzen eine Grundlage für den weiteren Einsatz von VHDL.

SG-Seminar-Nr.: 5330840

Anbieter-Seminar-Nr.: VHDL-BASIC

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